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8725B-21中文資料瑞薩數(shù)據(jù)手冊(cè)PDF規(guī)格書

8725B-21
廠商型號(hào)

8725B-21

功能描述

Differential-To-HSTL Zero Delay Clock Generator

文件大小

536.06 Kbytes

頁(yè)面數(shù)量

16 頁(yè)

生產(chǎn)廠商 Renesas Technology Corp
企業(yè)簡(jiǎn)稱

RENESAS瑞薩

中文名稱

瑞薩科技有限公司官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2024-12-24 13:35:00

8725B-21規(guī)格書詳情

Features

? One differential HSTL output pair?

One differential feedback output pair

? Differential CLK, nCLK input pair

? CLK, nCLK pair can accept the following differential ?

input levels: LVPECL, LVDS, HSTL, HCSL, SSTL

? Output frequency range: 31.25MHz to 630MHz

? Input frequency range: 31.25MHz to 630MHz

?VCO range: 250MHz to 630MHz

? External feedback for “zero delay” clock regeneration ?

with configurable frequencies

? Programmable dividers allow for the following output-to-input

frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8

? Cycle-to-cycle jitter: 50ps (maximum)

? Output skew: 50ps (maximum)

? Static phase offset: 200ps (maximum)

? 3.3V core, 1.8V output operating supply

? 0°C to 70°C ambient operating temperature

供應(yīng)商 型號(hào) 品牌 批號(hào) 封裝 庫(kù)存 備注 價(jià)格
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