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8731-01中文資料瑞薩數(shù)據(jù)手冊PDF規(guī)格書

8731-01
廠商型號

8731-01

功能描述

Low SKEW, 1-to-11 Differential-to-3.3V LVPECL Clock Multiplier / Zero Delay Buffer

文件大小

457.81 Kbytes

頁面數(shù)量

18

生產(chǎn)廠商 Renesas Technology Corp
企業(yè)簡稱

RENESAS瑞薩

中文名稱

瑞薩科技有限公司官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時間

2024-12-25 18:23:00

8731-01規(guī)格書詳情

FEATURES

? Eleven differential 3.3V LVPECL outputs

? Differential reference clock input pair

? REF_CLK, nREF_CLK pair can accept the following differential

input levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL

? Maximum output frequency: 700MHz

? Maximum reference clock input frequency: 200MHz

? VCO range: 250MHz - 700MHz

? Accepts any single-ended input signal with a resistor bias

on nCLK input

? External feedback for zero delay capabilitiy

? Output skew: 70ps (maximum)

? Cycle-to-cycle jitter: 65ps (maximum)

? Full 3.3V operating supply

? 0°C to 70°C ambient operating temperature

? Available in lead-free RoHS compliant package

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