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95V157YG-T中文資料瑞薩數(shù)據(jù)手冊PDF規(guī)格書

95V157YG-T
廠商型號

95V157YG-T

功能描述

2.5V Single-Ended to SSTL_2 Clock Driver (45MHz - 233MHz)

文件大小

358.12 Kbytes

頁面數(shù)量

10

生產(chǎn)廠商 Renesas Technology Corp
企業(yè)簡稱

RENESAS瑞薩

中文名稱

瑞薩科技有限公司官網(wǎng)

原廠標識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時間

2025-1-29 23:00:00

95V157YG-T規(guī)格書詳情

Recommended Application:

Single-ended clock input with zero delay board fan out

Product Description/Features:

? Low skew, low jitter PLL clock driver

? 1 to 10 differential clock distribution (SSTL_2)

? Feedback pin for input to output synchronization

? PD# for power management

? Spread Spectrum tolerant inputs

Switching Characteristics:

? CYCLE - CYCLE jitter: <60ps

? OUTPUT - OUTPUT skew: <60ps

? Period jitter: ±30ps

? DUTY CYCLE: 49.5 - 50.5

供應商 型號 品牌 批號 封裝 庫存 備注 價格
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