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9ZXL0651AKLFT集成電路(IC)的應(yīng)用特定時(shí)鐘/定時(shí)規(guī)格書PDF中文資料

廠商型號(hào) |
9ZXL0651AKLFT |
參數(shù)屬性 | 9ZXL0651AKLFT 封裝/外殼為40-VFQFN 裸露焊盤;包裝為卷帶(TR);類別為集成電路(IC)的應(yīng)用特定時(shí)鐘/定時(shí);產(chǎn)品描述:IC CLK BUFFER PLL 40QFN |
功能描述 | 6-Output DB800ZL Derivative with Integrated 85ohm Terminations |
封裝外殼 | 40-VFQFN 裸露焊盤 |
文件大小 |
634.24 Kbytes |
頁面數(shù)量 |
15 頁 |
生產(chǎn)廠商 | Renesas Technology Corp |
企業(yè)簡稱 |
RENESAS【瑞薩】 |
中文名稱 | 瑞薩科技有限公司官網(wǎng) |
原廠標(biāo)識(shí) | ![]() |
數(shù)據(jù)手冊(cè) | |
更新時(shí)間 | 2025-5-25 11:26:00 |
人工找貨 | 9ZXL0651AKLFT價(jià)格和庫存,歡迎聯(lián)系客服免費(fèi)人工找貨 |
9ZXL0651AKLFT規(guī)格書詳情
Features
? 25MHz PFT clock delay management
? Low-Power-HCSL outputs with Zo = 85?; save power
and board space – no termination resistors required.
Ideal for blade servers.
? Space-saving 40-pin VFQFPN package
? Fixed feedback path for 0ps input-to-output delay
? 6 OE# pins; hardware control of each output
? PLL or bypass mode; PLL can dejitter incoming clock
? Selectable PLL bandwidth; minimizes jitter peaking in
downstream PLLs
? Spread spectrum compatible; tracks spreading input
clock for low EMI
Key Specifications
? Cycle-to-cycle jitter < 50ps
? Output-to-output skew < 65ps
? Input-to-output delay variation < 50ps
? PCIe Gen3 phase jitter < 1.0ps RMS
? QPI/UPI 9.6GT/s 12UI phase jitter
產(chǎn)品屬性
- 產(chǎn)品編號(hào):
9ZXL0651AKLFT
- 制造商:
Renesas Electronics America Inc
- 類別:
集成電路(IC) > 應(yīng)用特定時(shí)鐘/定時(shí)
- 包裝:
卷帶(TR)
- PLL:
是
- 主要用途:
Intel QPI,PCI Express(PCIe)
- 輸入:
時(shí)鐘
- 輸出:
HCSL
- 比率 - 輸入:
1:6
- 差分 - 輸入:
是/是
- 電壓 - 供電:
3.135V ~ 3.465V
- 工作溫度:
0°C ~ 70°C
- 安裝類型:
表面貼裝型
- 封裝/外殼:
40-VFQFN 裸露焊盤
- 供應(yīng)商器件封裝:
40-VFQFPN(5x5)
- 描述:
IC CLK BUFFER PLL 40QFN
供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫存 | 備注 | 價(jià)格 |
---|---|---|---|---|---|---|---|
RENESAS |
24+ |
21+ |
9000 |
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詢價(jià) | ||
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