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CY7C1298H-133AXC中文資料賽普拉斯數(shù)據(jù)手冊(cè)PDF規(guī)格書

CY7C1298H-133AXC
廠商型號(hào)

CY7C1298H-133AXC

功能描述

1-Mbit (64K x 18) Pipelined DCD Sync SRAM

文件大小

383.79 Kbytes

頁(yè)面數(shù)量

16 頁(yè)

生產(chǎn)廠商 CypressSemiconductor
企業(yè)簡(jiǎn)稱

Cypress賽普拉斯

中文名稱

賽普拉斯半導(dǎo)體公司官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2024-11-7 13:00:00

CY7C1298H-133AXC規(guī)格書詳情

Functional Description[1]

The CY7C1298H SRAM integrates 64K x 18 SRAM cells with advanced synchronous peripheral circuitry and a two-bit counter for internal burst operation.

Features

? Registered inputs and outputs for pipelined operation

? Optimal for performance (Double-Cycle deselect)

— Depth expansion without wait state

? 64K × 18-bit common I/O architecture

? 3.3V core power supply (VDD)

? 2.5V/3.3V I/O power supply (VDDQ)

? Fast clock-to-output times

— 3.5 ns (for 166-MHz device)

? Provide high-performance 3-1-1-1 access rate

? User-selectable burst counter supporting Intel? Pentium? interleaved or linear burst sequences

? Separate processor and controller address strobes

? Synchronous self-timed writes

? Asynchronous Output Enable

? Available in JEDEC-standard lead-free 100-Pin TQFP package

? “ZZ” Sleep Mode option

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