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CY7C1302DV25-100

9-Mbit Burst of Two Pipelined SRAMs with QDR Architecture

FunctionalDescription TheCY7C1302DV25isa2.5VSynchronousPipelinedSRAMequippedwithQDR?architecture.QDRarchitectureconsistsoftwoseparateportstoaccessthememoryarray.TheReadporthasdedicateddataoutputstosupportReadoperationsandtheWritePorthasdedicateddatainput

CypressCypressSemiconductor

賽普拉斯賽普拉斯半導(dǎo)體公司

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更多CY7C1302DV25-100供應(yīng)商 更新時間2024-11-7 10:30:00

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