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CY7C1334H-133AXI

2-Mbit (64K x 32) Pipelined SRAM with NoBL??Architecture

FunctionalDescription[1] TheCY7C1334Hisa3.3V/2.5V,64Kx32synchronous-pipelinedBurstSRAMdesignedspecificallytosupportunlimitedtrueback-to-backRead/Writeoperationswithouttheinsertionofwaitstates.TheCY7C1334HisequippedwiththeadvancedNoBusLatency?(NoBL?)logicrequ

CypressCypressSemiconductor

賽普拉斯賽普拉斯半導(dǎo)體公司

CY7C1334H-133AXC

2-Mbit(64Kx32)PipelinedSRAMwithNoBL??Architecture

FunctionalDescription[1] TheCY7C1334Hisa3.3V/2.5V,64Kx32synchronous-pipelinedBurstSRAMdesignedspecificallytosupportunlimitedtrueback-to-backRead/Writeoperationswithouttheinsertionofwaitstates.TheCY7C1334HisequippedwiththeadvancedNoBusLatency?(NoBL?)logicrequ

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賽普拉斯賽普拉斯半導(dǎo)體公司

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更多CY7C1334H-133AXI供應(yīng)商 更新時(shí)間2025-1-26 10:30:00

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