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CY7C1347G-250BZI

4-Mbit (128K x 36) Pipelined Sync SRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250AXC

4-Mbit(128Kx36)PipelinedSyncSRAM

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CY7C1347G-250AXC

4-Mbit(128K?36)PipelinedSyncSRAM

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4-Mbit(128Kx36)PipelinedSyncSRAMAsynchronousoutputenable

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CY7C1347G-250AXC

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250AXI

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250BGC

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250BGI

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250BGXC

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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CY7C1347G-250BGXI

4-Mbit(128Kx36)PipelinedSyncSRAM

FunctionalDescription TheCY7C1347Gisa3.3V,128Kx36synchronous-pipelinedSRAMdesignedtosupportzero-wait-statesecondarycachewithminimalgluelogic.CY7C1347GIOpinscanoperateateitherthe2.5Vorthe3.3Vlevel;theIOpinsare3.3VtolerantwhenVDDQ=2.5V.Allsynchronousi

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