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CY7C1462AV25-200AXI

36-Mbit (1M x 36/2M x 18/512K x 72) Pipelined SRAM with NoBL??Architecture

CypressCypressSemiconductor

賽普拉斯賽普拉斯半導(dǎo)體公司

CY7C1462AV25-200

36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

FunctionalDescription TheCY7C1460AV25/CY7C1462AV25/CY7C1464AV25are2.5V,1Mx36/2Mx18/512x72SynchronouspipelinedburstSRAMswithNoBusLatency?(NoBL?)logic,respectively.Theyaredesignedtosupportunlimitedtrueback-to-backRead/Writeoperationswithnowaitstates.TheCY7C1460

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CY7C1462AV25-200AXC

36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

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CY7C1462AV25-200BZC

36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

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CY7C1462AV25-200BZI

36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

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36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

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CY7C1462AV25-200BZXI

36-Mbit(1Mx36/2Mx18/512Kx72)PipelinedSRAMwithNoBL??Architecture

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更多CY7C1462AV25-200AXI供應(yīng)商 更新時(shí)間2025-1-7 11:40:00