ICS93732FLF-T中文資料ICST數(shù)據(jù)手冊PDF規(guī)格書

廠商型號	ICS93732FLF-T
功能描述	Low Cost DDR Phase Lock Loop Zero Delay Buffer
文件大小	482.21 Kbytes
頁面數(shù)量	8 頁
生產(chǎn)廠商	Integrated Circuit Systems
企業(yè)簡稱	ICST
中文名稱	Integrated Circuit Systems官網(wǎng)
原廠標(biāo)識
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更新時間	2025-3-3 19:55:00
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Product Description/Features:

? Low skew, low jitter PLL clock driver

? Max frequency supported = 266MHz (DDR 533)

? I2C for functional and output control

? Feedback pins for input to output synchronization

? Spread Spectrum tolerant inputs

? 3.3V tolerant CLK_INT input

Switching Characteristics:

? CYCLE - CYCLE jitter (66MHz): <120ps

? CYCLE - CYCLE jitter (>100MHz): <65ps

? CYCLE - CYCLE jitter (>200MHz): <75ps

? OUTPUT - OUTPUT skew: <100ps

? DUTY CYCLE: 49.5 - 50.5

供應(yīng)商	型號	品牌	批號	封裝	庫存	備注	價格
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