ICS9P960中文資料瑞薩數(shù)據(jù)手冊PDF規(guī)格書
ICS9P960規(guī)格書詳情
Recommended Application
Dual DDR zero delay buffer
Features/Benefits
? High performance, low jitter zero delay buffer
? I2C for functional and output control
? Dual bank 1-6 differential clock distribution
? 2 separate feedback in & out for input to output
synchronization for each bank
? Supports up to 4 DDR DIMMs
? Supports up to DDRII - 1066MHz
? Supports up to DDRIII (1.8V core) - 1333MHz
? Output-to-output skew:
產(chǎn)品屬性
- 型號：
ICS9P960
- 功能描述：
IC CLK BUFF DUAL DDR 48SSOP
- RoHS：
是
- 類別：
集成電路(IC) >> 時鐘/計時 - 專用
- 系列：
-
- 標準包裝：
28
- 類型：
時鐘/頻率發(fā)生器
- PLL：
是
- 主要目的：
Intel CPU 服務器
- 輸入：
時鐘
- 輸出：
LVCMOS
- 電路數(shù)：
1 比率 -
- 3：
22 差分 -
- 輸出：
無/是 頻率 -
- 最大：
400MHz
- 電源電壓：
3.135 V ~ 3.465 V
- 工作溫度：
0°C ~ 85°C
- 安裝類型：
表面貼裝
- 封裝/外殼：
64-TFSOP(0.240，6.10mm 寬）
- 供應商設備封裝：
64-TSSOP
- 包裝：
管件
| 供應商 | 型號 | 品牌 | 批號 | 封裝 | 庫存 | 備注 | 價格 |
|---|---|---|---|---|---|---|---|
IDT |
2016+ |
TSSOP56 |
4822 |
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詢價 | ||
ICS |
24+ |
TSSOP |
58000 |
全新原廠原裝正品現(xiàn)貨,可提供技術支持、樣品免費! |
詢價 | ||
IDT |
24+ |
TSSOP56 |
65300 |
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IDT |
TSSOP |
68900 |
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IDT |
24+ |
56-TSSOP |
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ICS |
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SSOP48 |
100500 |
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ICS |
23+ |
0843+ |
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原裝 |
1922+ |
TSSOP56 |
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IDT |
23+ |
TSSOP56 |
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IDT |
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TSSOP56 |
3610 |
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詢價 |
