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Features
? Double-data-rate architecture; two data transfers per clock cycle
? Bidirectional data strobe(DQS)
? Four banks operation
? Differential clock inputs(CK and CK)
? DLL aligns DQ and DQS transition with CK transition
? MRS cycle with address key programs
-. Read latency 2, 2.5 (clock)
-. Burst length (2, 4, 8)
-. Burst type (sequential & interleave)
? All inputs except data & DM are sampled at the positive going edge of the system clock(CK)
? Data I/O transactions on both edges of data strobe
? Edge aligned data output, center aligned data input
? LDM,UDM/DM for write masking only
? Auto & Self refresh
? 15.6us refresh interval(4K/64ms refresh)
? Maximum burst refresh cycle : 8
? 66pin TSOP II package
產(chǎn)品屬性
- 型號：
K4H560438M-TCA2
- 制造商：
SAMSUNG
- 制造商全稱：
Samsung semiconductor
- 功能描述：
128Mb DDR SDRAM
| 供應(yīng)商 | 型號 | 品牌 | 批號 | 封裝 | 庫存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
SAMSUNG |
21+ |
35200 |
一級代理/放心采購 |
詢價(jià) | |||
SAMSUNG |
23+ |
TSOP |
3000 |
全新原裝、誠信經(jīng)營、公司現(xiàn)貨銷售 |
詢價(jià) | ||
SAMSANG |
19+ |
TSOP |
256800 |
原廠代理渠道,每一顆芯片都可追溯原廠； |
詢價(jià) | ||
SAMSUNG/三星 |
23+ |
TSOP |
13000 |
原廠授權(quán)一級代理,專業(yè)海外優(yōu)勢訂貨,價(jià)格優(yōu)勢、品種 |
詢價(jià) | ||
SAMSUNG |
23+ |
TSOP |
8000 |
只做原裝現(xiàn)貨 |
詢價(jià) | ||
SAMSUNG |
23+ |
TSOP |
7000 |
詢價(jià) | |||
SAMSUNG |
23+ |
TSOP |
7750 |
全新原裝優(yōu)勢 |
詢價(jià) | ||
SAMSUNG |
2023+ |
80000 |
一級代理/分銷渠道價(jià)格優(yōu)勢 十年芯程一路只做原裝正品 |
詢價(jià) | |||
SAMSUNG |
6000 |
面議 |
19 |
DIP/SMD |
詢價(jià) |
