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QS5917T-100TQG中文資料瑞薩數(shù)據(jù)手冊PDF規(guī)格書

QS5917T-100TQG
廠商型號

QS5917T-100TQG

功能描述

LOW SKEW CMOS PLL CLOCK DRIVER WITH INTEGRATED LOOP FILTER

文件大小

241.66 Kbytes

頁面數(shù)量

8

生產(chǎn)廠商 Renesas Technology Corp
企業(yè)簡稱

RENESAS瑞薩

中文名稱

瑞薩科技有限公司官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時間

2025-1-29 23:00:00

QS5917T-100TQG規(guī)格書詳情

FEATURES:

? 5V operation

? 2xQ output, Q/2 output, Q output

? Outputs tri-state while RST low

? Internal loop filter RC network

? Low noise TTL level outputs

? < 500ps output skew, Q0-Q4

? PLL disable feature for low frequency testing

? Balanced Drive Outputs ± 24mA

? 132MHz maximum frequency (2xQ output)

? Functional equivalent to Motorola MC88915

? ESD > 2000V

? Latch-up > –300mA

? Available in QSOP and PLCC packages

? Not Recommended for New Design

產(chǎn)品屬性

  • 型號:

    QS5917T-100TQG

  • 功能描述:

    時鐘發(fā)生器及支持產(chǎn)品 CLK DRVR PLL, FILTER

  • RoHS:

  • 制造商:

    Silicon Labs

  • 類型:

    Clock Generators

  • 最大輸入頻率:

    14.318 MHz

  • 最大輸出頻率:

    166 MHz

  • 輸出端數(shù)量:

    16 占空比 -

  • 最大:

    55 %

  • 工作電源電壓:

    3.3 V

  • 工作電源電流:

    1 mA

  • 最大工作溫度:

    + 85 C

  • 安裝風(fēng)格:

    SMD/SMT

  • 封裝/箱體:

    QFN-56

供應(yīng)商 型號 品牌 批號 封裝 庫存 備注 價格
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