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SY100S834LZITR中文資料麥瑞半導(dǎo)體數(shù)據(jù)手冊(cè)PDF規(guī)格書

SY100S834LZITR
廠商型號(hào)

SY100S834LZITR

功能描述

(?1, ?2, ?4) OR (?2, ?4, ?8) CLOCK GENERATION CHIP

文件大小

67.98 Kbytes

頁面數(shù)量

4

生產(chǎn)廠商 Micrel Semiconductor
企業(yè)簡(jiǎn)稱

Micrel麥瑞半導(dǎo)體

中文名稱

麥瑞半導(dǎo)體官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2024-12-25 15:29:00

SY100S834LZITR規(guī)格書詳情

DESCRIPTION

The SY100S834/L is low skew (÷1, ÷2, ÷4) or (÷2, ÷4, ÷8) clock generation chip designed explicitly for low skew clock generation applications. The internal dividers are synchronous to each other, therefore, the common output edges are all precisely aligned. The devices can be driven by either a differential or single-ended ECL or, if positive power supplies are used, PECL input signal.

FEATURES

■ 3.3V and 5V power supply options

■ 50ps output-to-output skew

■ Synchronous enable/disable

■ Master Reset for synchronization

■ Internal 75K? input pull-down resistors

■ Available in 16-pin SOIC package

供應(yīng)商 型號(hào) 品牌 批號(hào) 封裝 庫存 備注 價(jià)格
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