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UPD48288109AFF-E18-DW1

288M-BIT Low Laten cy DRAM Separate I/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:1.875ns@tRC=15ns 2.5ns@tRC=15ns 2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentia

RENESASRenesas Technology Corp

瑞薩瑞薩科技有限公司

UPD48288109AFF-E18-DW1-A

288M-BIT Low Laten cy DRAM Separate I/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:1.875ns@tRC=15ns 2.5ns@tRC=15ns 2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentia

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更多UPD48288109AFF-E18-DW1供應商 更新時間2024-10-25 16:30:00

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