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UPD48576118FF-E18-DW1-A

576M-BIT Low Latency DRAM Separate I/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:1.875ns@tRC=15ns 2.5ns@tRC=15ns 2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentia

RENESASRenesas Technology Corp

瑞薩瑞薩科技有限公司

UPD48576118FF-E18-DW1

576M-BITLowLatencyDRAMSeparateI/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:1.875ns@tRC=15ns 2.5ns@tRC=15ns 2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentia

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更多UPD48576118FF-E18-DW1-A供應(yīng)商 更新時(shí)間2025-1-24 15:22:00