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74ALS377DB中文資料飛利浦?jǐn)?shù)據(jù)手冊PDF規(guī)格書

74ALS377DB
廠商型號

74ALS377DB

功能描述

Octal D flip-flop with enable

文件大小

122.47 Kbytes

頁面數(shù)量

10

生產(chǎn)廠商 NXP Semiconductors
企業(yè)簡稱

Philips飛利浦

中文名稱

荷蘭皇家飛利浦官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時(shí)間

2025-1-21 16:00:00

74ALS377DB規(guī)格書詳情

DESCRIPTION

The 74ALS377 has eight edge-triggered D-type flip-flops with individual D inputs and Q outputs. The common buffered clock (CP) input loads all flip-flops simultaneously when the Enable (E) is Low.

The register is fully edge-triggered. The state of each D input, one setup time before the Low-to-High clock transition, is transferred to the corresponding flip-flop’s Q output. The E input must be stable one setup time prior to the Low-to-High clock transition for predictable operation.

FEATURES

? Ideal for addressable register applications

? Enable for address and data synchronization applications

? Eight edge-triggered D-type flip-flops

? Buffered common clock

? See 74ALS273 for master reset version

? See 74ALS373 for transparent latch version

? See 74ALS374 for 3-State version

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