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UPD48288218-A

288M-BIT Low Latency DRAM Common I/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentialinputclocks(CKandCK#) ?Differentialin

RENESASRenesas Technology Corp

瑞薩瑞薩科技有限公司

UPD48288218A

288M-BITLowLatencyDRAMCommonI/O

Features ?SRAM-typeinterface ?Double-data-ratearchitecture ?PLLcircuitry ?Cycletime:1.875ns@tRC=15ns 2.5ns@tRC=15ns 2.5ns@tRC=20ns 3.3ns@tRC=20ns ?Non-multiplexedaddresses ?Multiplexingoptionisavailable. ?DatamaskforWRITEcommands ?Differentia

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更多UPD48288218-A供應商 更新時間2025-1-9 14:21:00

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